计算机组成原理——输入/输出系统（十六）

【星辰大海终将抵达】 脚下的路或许崎岖，但每一步都算数；眼前的夜或许漫长，但长夜尽头有光。别怕跌倒，那些磨破的伤口终会成为盔甲；别惧迷茫，星辰的轨迹总在混沌中显现方向。若你此刻疲惫，不妨回头看看：曾经以为跨不过的山，如今已是身后的风景。人生没有白走的路，汗水会沉淀成底气，坚持会裂变成奇迹。继续奔跑吧，你向往的远方，终会与你不期而遇；你热爱的未来，正在回应你此刻的坚持。记住：你并不孤单——风会托起你的翅膀，时间会见证你的荣光。

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目录

9.3 程序中断方式

9.3.1 程序中断的概念

9.3.2 程序中断方式的基本中断控制逻辑

9.3.3 单级中断与多级中断

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9.3 程序中断方式 9.3.1 程序中断的概念

定义与作用 程序中断是计算机系统中一种重要的异步事件处理机制，指在程序执行过程中，由硬件或软件触发事件强制暂停当前程序，转而去执行特定的中断服务程序（ISR），处理完成后恢复原程序的执行。其核心目的是实现以下功能：

实时响应：快速响应外部设备请求（如键盘输入、网络数据到达）。资源复用：通过分时复用CPU资源，提升系统效率。错误处理：处理硬件故障（如内存校验错误）或软件异常（如除零错误）。

中断分类

分类标准类型说明触发源硬件中断由硬件设备触发（如I/O设备完成操作）软件中断由程序指令触发（如CPU的INT指令）可屏蔽性可屏蔽中断可通过中断屏蔽寄存器禁用（如定时器中断）不可屏蔽中断（NMI）必须立即响应的关键事件（如电源故障）响应方式向量中断通过中断向量直接跳转至服务程序轮询中断需软件查询中断源

中断处理流程

中断请求（IRQ）：设备通过中断线向CPU发出请求。中断响应：CPU完成当前指令后，检查中断优先级。保存现场：将程序计数器（PC）和状态寄存器（PSW）压入堆栈。执行ISR：根据中断向量表跳转至对应中断服务程序。恢复现场：从堆栈恢复PC和PSW，继续原程序执行。

C

// 示例：x86架构下中断服务程序框架 void __attribute__((interrupt)) timer_isr(struct interrupt_frame* frame) { // 1. 处理定时器中断 acknowledge_timer_interrupt(); // 2. 业务逻辑（如更新系统时钟） system_clock++; // 3. 发送EOI（End of Interrupt）信号 outb(0x20, 0x20); }

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9.3.2 程序中断方式的基本中断控制逻辑

硬件组成

中断控制器（PIC/APIC）：管理多个中断源，仲裁优先级。中断向量表（IVT）：存储中断服务程序入口地址的数组，索引由中断号决定。中断屏蔽寄存器（IMR）：控制是否允许特定中断触发。

关键电路设计

VERILOG

// 中断控制器简化逻辑（Verilog代码片段） module interrupt_controller ( input wire clk, input wire [7:0] irq_lines, // 8个中断请求线 input wire [7:0] imr, // 中断屏蔽寄存器 output reg int_signal, // 向CPU发出的中断信号 output reg [2:0] vector // 中断向量 ); always @(posedge clk) begin if (irq_lines & ~imr) begin // 未被屏蔽的中断请求 // 优先级编码器：选择最高优先级中断 casex (irq_lines) 8'b1xxxxxxx: vector = 3'b111; 8'b01xxxxxx: vector = 3'b110; // ... 其他优先级 default: vector = 3'b000; endcase int_signal = 1'b1; // 触发中断信号 end else begin int_signal = 1'b0; end end endmodule

中断控制流程

中断检测：硬件持续监控中断请求线。优先级仲裁：选择当前最高优先级中断。中断响应：CPU发送INTA信号确认中断。向量获取：控制器通过数据总线发送中断号。服务程序调用：CPU根据向量跳转至ISR。

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9.3.3 单级中断与多级中断

单级中断系统

特点：所有中断共享同一优先级，不可嵌套处理。优点：实现简单，硬件成本低。缺点：无法处理紧急事件，可能丢失高优先级中断。

处理流程

PLAINTEXT

+-------------------+ +---------------------+ | 主程序执行 | | 中断服务程序（ISR） | | ... | | 1. 保存现场 | | 发生中断 → 禁止中断 | → | 2. 处理中断 | | 恢复中断允许 | ← | 3. 恢复现场 | +-------------------+ +---------------------+

多级中断系统

特点：支持中断优先级划分和嵌套处理。关键组件： 优先级编码器：动态选择最高优先级中断。嵌套中断控制：允许高优先级中断抢占低优先级ISR。

优先级设计与嵌套示例

中断源优先级典型应用场景电源故障0（最高）不可屏蔽中断（NMI）硬盘DMA完成1高速数据传输键盘输入2用户交互定时器3系统时钟更新

ASSEMBLY

; x86多级中断处理示例（汇编代码） isr_high_priority: cli ; 禁用中断 pushad ; 保存通用寄存器 ; 处理高优先级中断（如硬盘DMA） call handle_dma popad sti ; 重新启用中断 iret isr_low_priority: cli pushad ; 处理低优先级中断（如键盘） call handle_keyboard popad sti iret ; 嵌套中断场景： ; 正在执行isr_low_priority时，若发生高优先级中断， ; CPU会暂停当前ISR，转而执行isr_high_priority。

对比总结

特性单级中断多级中断优先级支持无多级（通常4-256级）嵌套处理不可嵌套可嵌套响应延迟较高（需等待当前ISR完成）低（高优先级可抢占）硬件复杂度简单复杂（需优先级仲裁逻辑）典型应用简单嵌入式系统现代操作系统、实时系统

深度扩展：现代中断管理技术

中断亲和性（Affinity）：将中断绑定到特定CPU核心，提升缓存利用率。中断共享：多个设备共享同一中断线，需软件识别来源。线程化中断：将ISR分为顶半部（快速响应）和底半部（耗时处理）。

C

// Linux内核中的线程化中断示例 irqreturn_t irq_handler(int irq, void *dev_id) { // 顶半部：快速处理（如读取寄存器） struct device *dev = dev_id; u32 status = readl(dev->reg_base + STATUS_REG); if (!(status & INT_TRIGGERED)) return IRQ_NONE; // 调度底半部 tasklet_schedule(&dev->bottom_half); return IRQ_HANDLED; } void bottom_half_handler(unsigned long data) { // 底半部：耗时操作（如数据处理） struct device *dev = (struct device *)data; process_data(dev->buffer); }

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总结 程序中断机制是计算机系统实现高效异步事件处理的核心技术。从单级到多级中断的发展体现了系统对实时性和复杂场景的适应能力，而现代操作系统中的高级中断管理技术（如亲和性、线程化）进一步优化了性能与资源利用率。理解这些原理对于开发底层驱动、实时系统及性能关键型应用至关重要。